Datasheet

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White Cells – Sample N
Grey Cells – Sample N + 1
D11
(D0)
D11
(D0)
D5
(D0)
D4
(D7)
D4
(D7)
D8
(D3)
D8
(D3)
D1
(D10)
D1
(D10)
D5
(D6)
D5
(D6)
D10
(D1)
D10
(D1)
D3
(D8)
D3
(D8)
D7
(D4)
D7
(D4)
D0
(D11)
D0
(D11)
D9
(D2)
D9
(D2)
D2
(D9)
D2
(D9)
D6
(D5)
D6
(D5)
DataBitinLSBFirstMode
DataBitinMSBFirstMode
OutputData
DA0,DB0,DC0,DD0
OutputData
DA1,DB1,DC1,DD1
InWord-WiseMode
D10
(D0)
D11
(D1)
D8
(D2)
D9
(D3)
D4
(D6)
D5
(D7)
D3
(D9)
D10
(D0)
D11
(D1)
D8
(D2)
D9
(D3)
D6
(D4)
D7
(D5)
D2
(D8)
D2
(D8)
D3
(D9)
D0
(D10)
D6
(D4)
D7
(D5)
D4
(D6)
D5
(D7)
D0
(D10)
D1
(D11)
D1
(D11)
OutputData
DA0,DB0,DC0,DD0
OutputData
DA1,DB1,DC1,DD1
InBit-WiseMode
D5
(D0)
D5
(D0)
D11
(D6)
D11
(D6)
D2
(D3)
D2
(D3)
D8
(D9)
D8
(D9)
D4
(D1)
D4
(D1)
D10
(D7)
D10
(D7)
D1
(D4)
D1
(D4)
D7
(D10)
D7
(D10)
D3
(D2)
D3
(D2)
D9
(D8)
D9
(D8)
D0
(D5)
D0
(D5)
D6
(D11)
D6
(D11)
OutputData
DA0,DB0,DC0,DD0
OutputData
DA1,DB1,DC1,DD1
InByte-WiseMode
DataRate=6 Fs´
InputClock,
CLK
Freq=Fs
FrameClock,
FCLK
Freq=1 Fs´
BitClock – SDR,
DCLK
Freq=6 Fs´
BitClock – DDR,
DCLK
Freq=3 Fs´
T0226-01
ADS6424
ADS6423
ADS6422
SLAS532A – MAY 2007 – REVISED JUNE 2007
Figure 76. 2-Wire Interface 12 × Serialization
Copyright © 2007, Texas Instruments Incorporated 51
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