Datasheet
PIC32MX330/350/370/430/450/470
DS60001185C-page 62 2012-2013 Microchip Technology Inc.
TABLE 4-19: PORTA REGISTER MAP FOR PIC32MX330F064L, PIC32MX350F128L, PIC32MX350F256L, PIC32MX370F512L,
PIC32MX430F064L, PIC32MX450F128L, PIC32MX450F256L, AND PIC32MX470F512L DEVICES ONLY
Virtual Address
(BF88_#)
Register
Name
(1)
Bit Range
Bits
All
Resets
31/15 30/14 29/13 28/12 27/11 26/10 25/9 24/8 23/7 22/6 21/5 20/4 19/3 18/2 17/1 16/0
6000 ANSELA
31:16 — — — — — — — — — — — — — — — — 0000
15:0 — — — — — ANSELA10 ANSELA9 — — — — — — — — — 0060
6010 TRISA
31:16 — — — — — — — — — — — — — — — — 0000
15:0 TRISA15 TRISA14 — — — TRISA10 TRISA9 — TRISA7 TRISA6 TRISA5 TRISA4 TRISA3 TRISA2 TRISA1 TRISA0 xxxx
6020 PORTA
31:16 — — — — — — — — — — — — — — — — 0000
15:0 RA15 RA14 — — — RA10 RA9 — RA7 RA6 RA5 RA4 RA3 RA2 RA1 RA0 xxxx
6030 LATA
31:16 — — — — — — — — — — — — — — — — 0000
15:0 LATA15 LATA14 — — — LATA10 LATA9 — LATA7 LATA6 LATA5 LATA4 LATA3 LATA2 LATA1 LATA0 xxxx
6040 ODCA
31:16 — — — — — — — — — — — — — — — — 0000
15:0 ODCA15 ODCA14 — — — ODCA10 ODCA9 — ODCA7 ODCA6 ODCA5 ODCA4 ODCA3 ODCA2 ODCA1 ODCA0 xxxx
6050 CNPUA
31:16 — — — — — — — — — — — — — — — — 0000
15:0 CNPUA15 CNPUA14 — — — CNPUA10 CNPUA9 — CNPUA7 CNPUA6 CNPUA5 CNPUA4 CNPUA3 CNPUA2 CNPUA1 CNPUA0 xxxx
6060 CNPDA
31:16 — — — — — — — — — — — — — — — — 0000
15:0 CNPDA15 CNPDA14 — — — CNPDA10 CNPDA9 — CNPDA7 CNPDA6 CNPDA5 CNPDA4 CNPDA3 CNPDA2 CNPDA1 CNPDA0 xxxx
6070 CNCONA
31:16 — — — — — — — — — — — — — — — — 0000
15:0 ON — SIDL — — — — — — — — — — — — — 0000
6080 CNENA
31:16 — — — — — — — — — — — — — — — — 0000
15:0 CNIEA15 CNIEA14 — — — CNIEA10 CNIEA9 — CNIEA7 CNIEA6 CNIEA5 CNIEA4 CNIEA3 CNIEA2 CNIEA1 CNIEA0 xxxx
6090 CNSTATA
31:16 — — — — — — — — — — — — — — — — 0000
15:0
CN
STATA15
CN
STATA14
— — —
CN
STATA10
CN
STATA9
—
CN
STATA7
CN
STATA6
CN
STATA5
CN
STATA4
CN
STATA3
CN
STATA2
CN
STATA1
CN
STATA0
xxxx
Legend: x = Unknown value on Reset; — = Unimplemented, read as ‘0’; Reset values are shown in hexadecimal.
Note 1: All registers in this table have corresponding CLR, SET and INV registers at its virtual address, plus an offset of 0x4, 0x8 and 0xC, respectively. See Section 12.2 “CLR, SET, and INV Registers” for
more information.