Intel Xeon Processor and Intel E7500/E7501Chipset Compatible Platform Design Guide
VTT_DDR
R
D
C
B
B
D
C
1
12345678
2345678
A
A
LAST REVISED:
DRAWN BY:
1900 Prairie City Road
Folsom, California 095630 OF
TITLE:
PROJECT:
Rev:
KC533
Intel Corporation
VTT_DDR
VTT_DDR
+V2_5
DDRCVOL_B
DDRCVOH_B
BA0_B
BA1_B
CAS_N_B
CB0_B
CB1_B
CB2_B
CB3_B
CB4_B
CB5_B
CB6_B
CB7_B
CKE_B
CMDCLK0_B
CMDCLK0_N_B
CMDCLK1_B
CMDCLK1_N_B
CMDCLK2_B
CMDCLK2_N_B
CMDCLK3_B
CMDCLK3_N_B
CS0_N_B
CS1_N_B
CS2_N_B
CS3_N_B
CS4_N_B
CS5_N_B
CS6_N_B
CS7_N_B
DQ10_B
DQ11_B
DQ12_B
DQ13_B
DQ14_B
DQ15_B
DQ16_B
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DQ7_B
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DQ9_B
DQS0_B
DQS1_B
DQS10_B
DQS11_B
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DQS13_B
DQS14_B
DQS15_B
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DQS2_B
DQS3_B
DQS4_B
DQS5_B
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DQS9_B
MA0_B
MA1_B
MA10_B
MA11_B
MA12_B
MA2_B
MA3_B
MA4_B
MA5_B
MA6_B
MA7_B
MA8_B
MA9_B
DDRVREF0_B
DDRVREF1_B
DDRVREF2_B
DDRVREF3_B
RESERVED2
RESERVED1
RAS_N_B
RCVEN_IN_B
RCVEN_OUT_B
WE_N_B
DDRCOMP_B
DQ0_B
DQ1_B
DQ2_B
RESERVED0
DQ26_B
Address Bus
Check BitsCheck Bits
Low NibbleHigh NibbleLow NibbleHigh NibbleLow NibbleHigh NibbleHigh Nibble Low Nibble High Nibble Low Nibble High Nibble Low Nibble High Nibble Low Nibble High Nibble Low Nibble High Nibble Low Nibble
Chip Select
Command ClockVoltage Ref
MCH DDR B
Data Group 0Data Group 0Data Group 1Data Group 1Data Group 2Data Group 2Data Group 3Data Group 3Data Group 4Data Group 4Data Group 5Data Group 5Data Group 6Data Group 6Data Group 7Data Group 7
E7500: 0.01uF
E7501:NOPOP
E7500: 0.01uF
RESERVED1 & RESERVED2
E7500:0 ohms
E7501: NOPOP
MCH DDR Channel B
E7500: NOPOP
E7500: 6.98 ohms
E7501: NOPOP
E7501:24.9 ohms
E7500: 0.01uF
E7501:NOPOP
E7500: 6.98k ohm
E7501:NOPOP
E7500: 13k ohm
E7501:NOPOP
E7500: 0 ohm
E7501:NOPOP
R181 and leave R182, R183, C779, and C780 stuffed.
changing from E7500 to E7501, you can just remove
R181 is used for easy validation purposes. When
E7501: 49.9ohms
E7500: 0.01uF
E7501: 1 nF
E7501: NOPOP
E7500: 6.98K
E7501: 49.9
E7500: 13k
13 85
R185
6.98
1%
NOPOP
R195
24.9
1%
C784
1 NF
V29
W32
K26
H27
H28
V28
U25
Y31
AA33
U28
U27
AA31
AA32
M32
J29
J28
L28
M28
J26
K25
K27
L27
AH29
AK32
AF30
AF27
AE31
AE26
AD28
Y27
P27
P25
J31
L31
P26
P28
T29
T30
U30
T26
R32
T27
V33
V31
P30
P33
T32
N32
P31
N25
R28
T25
W27
AE33
AF31
W25
AA28
AD32
AG33
W26
N27
AA29
AB33
V26
AD31
Y28
AB32
AB29
V25
Y25
AB27
G32
AH32
AH31
AC28
AA26
AG30
AH33
AJ30
AG29
AB25
AA25
M29
AL32
AJ31
AC27
AB26
N26
J33
K32
L30
M31
N29
U31
R31
AC30
AB30
AD27
AF28
Y30
U33
R29
AE32
AC31
AE28
AE27
W29
H31
M26
K29
L25
C31
C32
H30
G30
F32
G29
F31
E33
E31
F29
AC25
AG32
U26
N33
M25
E30
V32
N30
R25
D32
W30
F33
K30
J32
K33
R26
U66
R197
13K 1%
NOPOP
C781
0.01UF
NOPOP
C782
0.01UF
NOPOP
DDRCVO_B
R196
6.98K
1%
NOPOP
12,76
VREF_DDR_MCH
DDRB_CMDCLK0_N
21
R1052
0
NOPOP
R187
49.9
1%
DDRB_DRCOMP
6.98K
1%
R188
NOPOP
R198
0
NOPOP
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24
DDRB_RCV_EN_IN
24
R1274
49.9
1%
R1051
0
NOPOP
DDRB_CMDCLK1
22
C1146
0.1UF
0.1UF
C1147
C1148
0.1UF
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23
DDRB_CMDCLK2_N
23
DDRB_CMDCLK1_N
22
DDRB_CMDCLK0
21
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19,21,22,23
DDRB_CAS_N_R
21,22,23,24
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21,22,23,24
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21,22,23,24
DDRB_MA10_R
19,21,22,23
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21,22,23,24
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21,22,23,24
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21,22,23,24
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DDRB_MA1_R
21,22,23,24
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19,21
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19,21
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22,24
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23,24
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23,24
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20
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20
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20
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20
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20
20
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20
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20
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20
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20
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20
20
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20
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20
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20
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21,22,23,24
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20
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20
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20
DDRB_DQ3
20
DDRB_CB4
DDRB_DQS17
20
DDRB_DQS8
20
INTEL (R) E7501 CHIPSET CUSTOMER REFERENCE BOARD 1.0
11/18/02
DDRB_CKE0
19,21,22,23